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modelsim最新版本为用户们提供了十分友好的仿真环境，作为FPGA/ASIC设计的首选仿真软件之一，其功能十分强大，不仅拥有强有力的波形比较，能够让用户更加方便的分析差异和错误，还有高级代码覆盖和分析工具，可快速覆盖范围，有需要的话就赶紧来下载使用吧~
提供友好的仿真环境，是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器
支持的Verilog，SystemVerilog的设计，VHDL和SystemC对复杂的设计环境的有效核查
交互式和后期模拟调试可用，因此两者都使用相同的调试环境
· C和Tcl/Tk接口，C调试；
· 对SystemC的直接支持，和HDL任意混合；
· 支持SystemVerilog的设计功能；
· 对系统级描述语言的最全面支持，SystemVerilog，SystemC，PSL；
· ASIC Sign off。
· 可以单独或同时进行行为（behavioral）、RTL级、和门级（gate-level）的代码。
· RTL和门级优化，本地编译结构，编译仿真速度快，跨平台跨版本仿真；
· 单内核VHDL和Verilog混合仿真；
· 源代码模版和助手，项目管理；
· 集成了性能分析、波形比较、代码覆盖、数据流ChaseX、Signal Spy、虚拟对象Virtual Object、Memory窗口、Assertion窗口、源码窗口显示信号值、信号条件断点等众多调试功能；
采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术
编译仿真速度快，编译的代码与平台无关，便于保护IP核
个性化的图形界面和用户接口，为用户加快调错提供强有力的手段
FPGA/ASIC设计的必备神器，使用起来十分简便
统一的混合语言模拟引擎，易于使用和性能
快速调试，易于使用，多语言调试环境
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